0424【東京/山梨】装置開発部／センシング開発 エレキエンジニア

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• エージェント求人

  【東京】AI創発型ロボティクスソリューションに関するロボットシステムの研究開発者

  1160~1330万

  日立製作所東京都国分寺市

  【東京】AI創発型ロボティクスソリューションに関するロボットシステムの研究開発者気になる

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  仕事内容

  【配属組織名】 研究開発グループ Next Research ロボティクスプロジェクト 【募集背景】 Next Research ロボティクスプロジェクトは2025年度に新たに発足したチームであり、ロボティクスの次のトレンドとなる技術についての検討を重ね、作業工法とロボット構造の組合せをAIに創発させる「AI創発型ロボティクスソリューション」のコンセプトを提唱しました。このコンセプトを早期に実現し、社内外へと発信していくため、研究開発体制および将来事業化を見据えた検討体制の強化が必要となっています。 【職務概要】 ・ロボティクス／AI／シミュレーション分野における研究開発を通じ、社会課題解決やフロンティア開拓につながるロボティクス技術の創出に取り組みます。 ・特に、日立が提唱する「作業工法とロボット構造のAI創発」コンセプトの実現に向けた技術開発およびロボットシステムの試作・検証を担当します。 ・担当分野における技術開発の責任者または専門家として、社内外の多様なステークホルダーとのバランスを加味し、社内外の関係者との関係を構築します。 ・自身の経験や先行研究から積極的に学習し、自身とチームの研究の完遂を通じて、最善の方法を生み出すことも求められます。 【職務詳細】 ・上長からの指導を受けながら、組織が掲げる技術コンセプト実現に向けた研究開発の重要部分に関する計画・実行の責任を担います。とくに、ロボティクスの次のトレンドとして日立が提唱している「作業工法とロボット構造のAI創発」コンセプト実現に向けた技術開発やロボットシステム試作検証の主要部分の責任を担い、必要に応じてチームメンバと連携しながら、その責任を全うしていきます。 ・ロボティクス関連イノベーションのロードマップ・戦略・実現計画の策定に関与し、上長からの指導を受けながらその計画遂行を牽引します。 ・ロボティクスの動向およびその適用先候補の分野動向について、最新情報を収集し、組織の知識アップデートに貢献します。 ・日立事業部/大学/パートナ企業との連携に向け、連携先候補の選定、連携計画の策定、連携活動の推進に主体的に関与します。 ・研究成果物（研究報告書、特許、学会発表、論文など）を提出します。 【ポジションの魅力・やりがい・キャリアパス】 ・エネルギ・資源・食糧の供給量増大と環境負荷低減の両立という難しい社会課題の解決に向けた研究開発、研究機関主導の新事業創生に関わることができます。 ・ロボティクスの次のトレンドを日立主導で立ち上げるという日立の野心的チャレンジに直接的に関与できる。「作業工法とロボット構造のAI創発」という未成熟の分野を主導的に開拓していくことで、その道の第一人者になれる可能性もあります。 ・近い将来に3~4名の研究チームの取り纏めを担うことも想定されます。 【働く環境】 ・ロボティクスプロジェクトは、2025年度現在、リーダ主任研究員の下、主任研究員3名、研究員4名、企画員1名で構成されています。26歳～45歳、平均年齢36歳の幅広い年齢層で、掲げている技術コンセプトに共感し、難しい課題に前向きにチャレンジしているメンバが多いです。 ・在宅勤務可能です。出社頻度はメンバによって様々で、平均は週2~3日です。ただし、実機を扱う業務では出社が必要となります。

  求める能力・経験

  ・ロボティクス関連技術(ハード、ソフトいずれも可、メカトロニクス、システム制御、ロボット知能も含む)の研究開発経験5年以上） ・上記経験を含む研究開発あるいは製品開発経験10年以上 ・国際学会発表のご経験 ・TOEIC650点程度の英語力(読み書き・メール利用に支障のないレベル)

  事業内容

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• エージェント求人

  ST：アナログ/ミックスドシグナル

  700~2000万

  • アナログ回路設計
  • デジタルアナログ混載取扱
  • デジタルアナログ混載回路設計
  • デジタルアナログ混載レイアウト...
  • アナログICデバイス設計
  • アナログIC

  【社名非公開】米国系MEMSタイミングデバイス・メーカー（世界No.1）東京都品川区

  ST：アナログ/ミックスドシグナル気になる

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  仕事内容

  ■職種名：アナログ・ミックスドシグナル回路設計エンジニア ■求人企業名：【社名非公開】 　米国系MEMSタイミングデバイス・メーカー（世界No.1） ■仕事内容： 業界をリードするタイミング製品のアナログおよびミックスドシグナルASIC設計に携わる、才能と熱意のあるプリンシパルエンジニアを募集しています。 　MEMSとアナログ半導体の会社である弊社は、ユニークなMEMSベースのシリコンタイミングソリューションで60億ドルのタイミング市場に革命を起こしています。MEMSタイミングの90％のシェアを持ち、15億個以上のデバイスを出荷している弊社は、エレクトロニクス業界の水晶発振器を100％シリコンベースのタイミングへの移行を推進しています。 　本社は、カリフォルニア州サンタクララ、日本にもの東京デザインセンターを設立して拡大を続けています。 ■職務内容 ・CMOSまたはBiCMOSプロセスによるアナログおよびミックスドシグナルのアーキテクチャと回路の開発・技術、アーキテクチャ、回路設計、パラメトリック設計のトレードオフを分析し、積極的な技術的性能仕様を満たす。 ・業界をリードするEDAツールを用いたトランジスタレベルの設計とシミュレーションの実行 ・包括的なデザインレビューのリード ・アナログ回路の物理設計レイアウトの監督およびレイアウトの編集 ・デジタル設計エンジニア、CAD、システム・エンジニアリング、テスト・エンジニアリング、アプリケーション・チームとのコラボレーションにより、DFT、DFM機能を確保し、シリコンの早期立ち上げと製品リリースまでの時間短縮を実現 ・設計を検証するためのポストレイアウト寄生抽出およびバックアノテーションされたシミュレーションの実行 ・シリコン試作品の立ち上げに参加 ・根本原因分析のための実験計画を開始し、PVT条件でのシリコンの異常現象を調査し、解決策を提案する。

  求める能力・経験

  ■必要条件 〇理学士（5年以上の経験）、理学修士（1年以上の経験）、電気工学博士（1年以上の経験 〇以下の項目に対する深い理解と実務経験 ・回路アーキテクチャの開発と技術的なフィージビリティスタディ ・ブロックレベルの詳細仕様書およびレビュードキュメントの作成 ・以下のうち1つ以上の詳細設計およびシミュレーション。発振器、ADC、DAC 、温度センサ、整数およびフラクショナル-N PLL、デジタルPLL、低ノイズオペアンプ、レギュレータ、CMOSまたはBiCMOSプロセスにおけるバンドギャップ回路、サブスレッショルド回路およびアーキテクチャ。 ・Cadence社のVirtuoso、Spectre、ADE、Mixed-mode AMSツール、Layout XLなどのEDAツールに精通していること。 ・回路およびレイアウト設計のためのレイアウト効果に関する豊富な知識 レイアウト設計者を監督する能力 ・ポストレイアウト抽出と検証の経験 ・バリデーション、キャラクタリゼーション、クオリフィケーション、およびプロダクションリリース基準の遵守に関する経験 ・地理的に分散しているミックスドシグナル、デジタル、検証エンジニアのチームとコミュニケーションをとり、効果的に仕事をする能力 ・独立して仕事をし、困難な問題の解決を推進する能力 ★ビジネスレベルの英語力

  事業内容

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• 企業ダイレクト

  【山梨_電気設計】構想設計、回路設計等幅広い設計業務

  500~750万

  

  株式会社テクノプロ山梨県韮崎市

  【山梨_電気設計】構想設計、回路設計等幅広い設計業務気になる

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  仕事内容

  成膜装置の電気設計として、構想設計、回路設計、ケーブルルート検討、部品選定、評価を幅広く担当いただきます。 【仕事内容】半導体製造装置（成膜装置）に関わる電気設計業務を担当いただきます。 【当社の強み：顧客のパートナー会社としての立ち位置】 現場でのエンジニアのスタンスや技術力から積み重ねた圧倒的信頼をもとに、設計開発、要件定義などの上流工程の案件も多数保有するエンジニアリング企業です。幅広い案件からあなたの望むキャリアを築く基盤が整っています。

  求める能力・経験

  【必須】■装置や設備の電気設計経験 【当社の魅力】1.顧客基盤の盤石性：ただ案件数が多いだけでなく、国が投資する最先端分野に注力した案件を多数保有していることから 「景気に左右されず予算が投じられる安定性」と「技術の成長性」を併せ持っている企業です。　2．製造業の激動期でも活躍可能な力が身につく：メーカーでは「製品軸」でキャリアを積むのに対し当社では「技術軸」でキャリアを積むため、所属業界の先行きが不安でも時代に合わせて活躍できる力を培えます。「どこに行っても通用する」力を身に着けることで変化の多いこの時代での安定を手に入れることができます。

  事業内容

  テクノプログループのビジネスモデルはアウトソーシング領域全域に渡ります。 AI、制御システム、機構・ハードウェア・ソフトウェアを中心とする技術領域における技術開発分野や商品開発分野への技術サービス、コンサルティングサービス

• 企業ダイレクト

  【東京・北海道_エンジニア】パッケージ設計_メンバー

  500~750万

  

  株式会社テクノプロ東京都千代田区, 北海道千歳市

  【東京・北海道_エンジニア】パッケージ設計_メンバー気になる

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  仕事内容

  RDLインターポーザ・樹脂パッケージ設計における環境構築、ライブラリ作成、配置配線、DRC/LVS検証、製造向けデータ作成を担当いただきます。 【具体的な仕事内容】■仕様確認および要件整理、設計フローへの反映■テクノロジーファイル設定（層構成、材料、配線ルール、DRC設定等 【当社の強み：顧客のパートナー会社としての立ち位置】 現場でのエンジニアのスタンスや技術力から積み重ねた圧倒的信頼をもとに、設計開発、要件定義などの上流工程の案件も多数保有するエンジニアリング企業です。幅広い案件からあなたの望むキャリアを築く基盤が整っています。

  求める能力・経験

  【必須スキル】■パッケージ設計■基板設計■EDA環境設定に関わる経験■DRCルールや層構成など設計ルールに関する基本理解■データ作成検証資料作成の実務経験 【歓迎スキル】■RDLインターポーザや樹脂パッケージ設計経験■パネル面付けや製造向けデータ作成経験■DRC/LVS検証フロー構築経験■EDA環境設定（テクノロジーファイル、ライブラリ作成など）の経験

  事業内容

  テクノプログループのビジネスモデルはアウトソーシング領域全域に渡ります。 AI、制御システム、機構・ハードウェア・ソフトウェアを中心とする技術領域における技術開発分野や商品開発分野への技術サービス、コンサルティングサービス

• 企業ダイレクト

  【東京・北海道_エンジニア】デジタルIC設計_メンバー

  500~750万

  

  株式会社テクノプロ東京都千代田区, 北海道千歳市

  【東京・北海道_エンジニア】デジタルIC設計_メンバー気になる

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  仕事内容

  2nm対応デジタルIC設計フローの構築・検証、PPA評価・最適化、および顧客へのフロー導入・技術サポートを担当いただきます。 【当社の強み：顧客のパートナー会社としての立ち位置】 現場でのエンジニアのスタンスや技術力から積み重ねた圧倒的信頼をもとに、設計開発、要件定義などの上流工程の案件も多数保有するエンジニアリング企業です。幅広い案件からあなたの望むキャリアを築く基盤が整っています。

  求める能力・経験

  <必須>デジタルIC設計またはデジタル設計フロー構築運用に関する実務経験/EDAツールの使用経験<当社の魅力>1.顧客基盤の盤石性：ただ案件数が多いだけでなく、国が投資する最先端分野に注力した案件を多数保有して いることから「景気に左右されず予算が投じられる安定性」と「技術の成長性」を併せ持っている企業です。　2．製造業の激動期でも活躍可能な力が身につく：メーカーでは「製品軸」でキャリアを積むのに対し当社では「技術軸」でキャリアを積むため、所属業界の先行きが不安でも時代に合わせて活躍できる力を培えます。「どこに行っても通用する」力を身に着けることで変化の多いこの時代での安定を手に入れることができます。

  事業内容

  テクノプログループのビジネスモデルはアウトソーシング領域全域に渡ります。 AI、制御システム、機構・ハードウェア・ソフトウェアを中心とする技術領域における技術開発分野や商品開発分野への技術サービス、コンサルティングサービス

• エージェント求人

  アナログ回路設計　＊フルリモート勤務。裁量労働制ですのでご自身でタイムコントロール出来る環境です。

  650~850万

  • アナログ回路設計
  • 半導体
  • ASICレイアウト設計
  • FPGAレイアウト設計
  • デジタル回路設計

  シリコンライブラリ株式会社東京都品川区

  アナログ回路設計　＊フルリモート勤務。裁量労働制ですのでご自身でタイムコントロール出来る環境です。気になる

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  仕事内容

  高速インターフェースIPの回路設計、新規回路アーキテクチャーの開発、ディジタルアシストのアナログ回路設計 標準規格（HDMI、DisplayPort、MIPI等）の規格に基づいたIP開発のため、規格（英文）の理解、仕様書作成、回路設計を行う。PLL、CDR等の設計経験があれば優遇。 また、顧客の要求仕様に基づきIP仕様書としてまとめ開発を行う場合もある。 概略の業務フローは以下の通りです。 1）規格の理解 2）アーキテクチャ検討（Matlab等での検討） 3）仕様書（データシート）作成 4）テストベンチ作成 5）回路設計  6）Forward Annotation（pre－layout simulation） 7）レイアウト設計・検証 8）Back Annotation（post layout simulation） 9）評価仕様作成 必ずしもすべての工程を行う訳ではありませんが、開発主要工程は理解していることが必要です。 レイアウトの経験があれば良いですが、必須ではありません。 ☆主な取引先：ローム、ソニー、メガチップス、サムスン等（受託開発ではありません） ＊フルリモート（在宅）勤務。裁量労働制ですのでご自身でタイムコントロール出来る環境です。

  求める能力・経験

  必須（MUST） ・高専卒以上 / 経験者のみ募集 ・アナログ回路設計実務経験5年程度以上（大学院等（博士課程修了者優遇）での経験も含む） ・マネジメント経験は不要 ・業界は半導体・電気電子・精密機器（装置）メーカー出身者歓迎 歓迎（WANT） ・英語での技術会話能力 ・ディジタル回路技術に関する知識あるいは経験

  事業内容

  〇業務内容 ：半導体設計用LSI/IPの設計、開発、販売、コンサルティング 1.高速インターフェースLSI 2.高速インターフェースIP 3.ミリ波（60GHz）ワイヤレスモジュール 〇経営戦略・ビジョン 大手IPベンダーに比べ、小回りの利く手厚いサポートを通じ、最先端から旧来のプロセス迄幅広く顧客要求に沿ってIPを提供することにより、LSIの開発を促進し、社会への貢献を行う。

• エージェント求人

  SK：DRAMアナログ設計

  700~2500万

  • メモリ
  • 半導体
  • アナログ回路設計
  • 検証
  • DRAM回路設計
  • DRAM

  【社名非公開】超大手メモリーメーカー東京都港区

  SK：DRAMアナログ設計気になる

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  仕事内容

  【今回の求人企業のご紹介】 勤務先となる企業は、現在世界中が注目する「AI半導体・HBM（高帯域幅メモリ）」分野で世界トップシェアを誇るグローバルカンパニーです。 特定のメモリ製品において世界初・世界最速の技術を次々と発表しており、事実上の業界標準（デファクトスタンダード）を創り出しています。 従来のメモリ設計の常識を覆す「積層技術」や「超高速アナログ回路」の融合が進んでおり、あなた様が培われたアナログ設計の深い知見が、AIの進化を直接支えることになります。 ここでの経験は、単なるエンジニアとしてのキャリアアップにとどまらず、世界の半導体産業の最前線に立っているという、極めて高い市場価値を約束してくれると考えられます。 エンジニアとして、世界最高峰のご企業で当に最先端のDRAM開発にチャレンジできるチャンスではありませんでしょうか。 ご紹介する機会を頂けますと幸いです。 --------------------------- ■職種名：【DRAM】回路設計エンジニア 　・アナログ回路設計エンジニア ■求人企業名：【社名非公開】超大手メモリーメーカー ■仕事内容 ・DRAMメモリーのアナログ回路設計、検証をお任せいたします。

  求める能力・経験

  ●必要な経験・能力等 【必須】 ・ DRAMメモリーのアナログ回路設計経験、検証経験 ・ 日常会話レベル以上の英語力

  事業内容

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• エージェント求人

  S-E：：Catapult-FAE

  800~1500万

  • 検証
  • 検証設計

  【社名非公開】超大手外資系ツールベンダー（ヨーロッパ系）東京都品川区

  S-E：：Catapult-FAE気になる

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  仕事内容

  ■職種名：フィールドアプリケーション・エンジニアーCatapalt ■求人企業名：【社名非公開】 超大手外資系ツールベンダー（ヨーロッパ系） （旧・メンター・グラフィックス・ジャパン株式会社） ■業務内容 下記の仕事を担当して頂きます。 1. 高位合成ツールCatapultの技術サポート(顧客サポート)、および営業/マーケティング支援 2. 顧客に対するソリューション提案・実施 　顧客の潜在的なニーズや課題を理解し、それに基づいて最適な製品のソリューションを提案します。 3. 開発チームへと顧客との間のブリッジとしての役割 　顧客からのフィードバックやニーズを収集し、それを必要に応じて開発チームにレポートします。 　顧客の声を製品開発プロセスに反映させることで、製品の改善と顧客満足度の向上を図ります。

  求める能力・経験

  ■応募資格（必須要件） •Verilog 、SystemVerilog、あるいは VHDL のRTL記述が理解できる(読める)こと •C++、あるいはSystemC の記述が理解できること •論理検証/機能検証の方法論、概念を理解していること •Microsoft Excel, Word, PowerPoint, OutlookならびにWeb Browserを使いこなせること •プレゼンテーション･スライドの作成、また、人前でそれを用いた発表、質疑応答の経験があること •Linux/Unix環境でのスクリプト言語のコーディング経験（Tcl, Perl, Pythonまたは同等のもの） ■応募資格（歓迎要件） •RTL、テストのHDL記述ができることが望ましい •C++もしくはSystemCモデリング(記述)出来ることが望ましい •オブジェクト思考の概念を理解していることが望ましい •高位合成技術の知識、経験を有することが望ましい •Python、Tensor Flow、MATLAB/Simulinkなどのより高位の知識や経験を有することが望ましい •営業支援活動の経験を有することが望ましい •ML経験を有することが望ましい ■言語力 ▼英語：英語への抵抗がない方 英文技術文章の理解、メールで海外開発チームとの連携 ▼日本語：日本語能力試験 N1以上

  事業内容

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• エージェント求人

  SK：DRAMデジタル設計

  700~2500万

  • メモリ
  • デジタル回路設計
  • 開発
  • 検証
  • DRAM回路設計
  • DRAM

  【社名非公開】超大手メモリーメーカー東京都港区

  SK：DRAMデジタル設計気になる

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  仕事内容

  【今回の求人企業のご紹介】 勤務先となる企業は、現在世界中が注目する「AI半導体・HBM（高帯域幅メモリ）」分野で世界トップシェアを誇るグローバルカンパニーです。 特定のメモリ製品において世界初・世界最速の技術を次々と発表しており、事実上の業界標準（デファクトスタンダード）を創り出しています。 従来のメモリ設計の常識を覆す「積層技術」や「超高速アナログ回路」の融合が進んでおり、アナログ設計エンジニアと連携しながら貴方が培ってこられたデジタル設計の深い知見が、AIの進化を直接支えることになります。 ここでの経験は、単なるエンジニアとしてのキャリアアップにとどまらず、世界の半導体産業の最前線に立っているという、極めて高い市場価値を約束してくれると考えられます。 エンジニアとして、世界最高峰のご企業で当に最先端のDRAM開発にチャレンジできるチャンスではありませんでしょうか。 ご紹介する機会を頂けますと幸いです。 --------------------------- ■職種名：【DRAM】回路設計エンジニア 　・デジタル回路設計エンジニア ■求人企業名：【社名非公開】超大手メモリーメーカー ■仕事内容 ・DRAMメモリーのデジタル回路設計、検証をお任せいたします。

  求める能力・経験

  ●必要な経験・能力等 【必須】 ・ DRAMメモリーのデジタル回路設計経験、検証経験 ・ 日常会話レベル以上の英語力

  事業内容

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• エージェント求人

  半導体回路設計シニアエンジニア Senior Staff Engineer Elect Design

  600~900万

  • Python
  • 半導体
  • Perl
  • Shell

  外資系半導体メーカー東京都渋谷区

  半導体回路設計シニアエンジニア Senior Staff Engineer Elect Design気になる

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  仕事内容

  Responsible for planning and execution of all aspects of Physical Design Implementation including Synthesis, Floor planning, Place and Route, Clock Tree Synthesis, IP integration, Extraction, Physical Verification using EDA tool chain （FusionCompiler） w/ the low power design. • Responsible for planning and execution of Timing Related Checks which include Timing Fixture, Hold ＆ Setup Requirement, DRV checks, Power Intent spec and checks and all Signoff Checks • Support the schedule and plan arrangements to meet project milestones deadlines, aligning w/ the other cluster designer, reporting regularly to project manager the status of the entire layout development. • The candidate should have reasonable ability to automate design work by means of script programming, e.g. Tcl/tk and Python.

  求める能力・経験

  • 3＋ years of hands－on experience in Floorplanning, Place and Route, Clock tree synthesis, Physical Verification error fixing and logic synthesis • Understanding of timing constraints, Static Timing Analysis and timing sign－off conditions • Understanding of IREM flow and Multiple power domain design flow. • Team Worker • Language: Business level Japanese, Business level English • Deep understanding of scripting languages （shell, perl, tcl and Physon） and Make flow • Drive ambitious schedules and enables dependent teams to accomplish.

  事業内容

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